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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › Analog Layout（版图） › Layout讨论区 › std不加tapcell怎么过lvs！！！
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查看: 664|回复: 4

[求助] std不加tapcell怎么过lvs！！！

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tutufirst
发表于 2024-12-2 10:42:37 | 显示全部楼层 |阅读模式

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std想不加tapcell可以直接过lvs

cdl里定义了pbulk nbulk
版图里也有pbulk nbulk的label
pbulk用的NW_text层
nbulk用的PW_text层

但是跑lvs的时候版图里依然提不出pbulk nbulk的label
是需要在lvs文件里定义吗

求助大神
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ssdgege
发表于 2024-12-2 16:08:24 | 显示全部楼层
验证文件里应该不能识别NW和PW的text层次，一般都是铝线和poly可以识别，你仔细看一下你的验证文件
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tutufirst
 楼主| 发表于 2024-12-2 16:29:55 | 显示全部楼层


ssdgege 发表于 2024-12-2 16:08
验证文件里应该不能识别NW和PW的text层次，一般都是铝线和poly可以识别，你仔细看一下你的验证文件 ...


是的，所以想问下，要添加什么语句可以把NW和PW的text层次识别出来
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ssdgege
发表于 2024-12-2 19:12:58 | 显示全部楼层


tutufirst 发表于 2024-12-2 16:29
是的，所以想问下，要添加什么语句可以把NW和PW的text层次识别出来


TEXT LAYER MET1

PORT LAYER TEXT MET1
ATTACH MET1 MET1
到你的验证文件里去找类似这快的定义，然后照葫芦画瓢
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tutufirst
 楼主| 发表于 2024-12-3 08:58:04 | 显示全部楼层


ssdgege 发表于 2024-12-2 19:12
TEXT LAYER MET1

PORT LAYER TEXT MET1


我去试下，感谢！
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