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[求助] Veriloga求助

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发表于 昨天 14:55 | 显示全部楼层 |阅读模式

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如图所示，是一个很简单的一个分频器功能的veriloga代码，在tran仿真下可正常仿真出结果。但在pss仿真环境下，则老是报错。不知各位大佬有没有遇见过，有没有什么解决办法！谢谢

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