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[求助] Xilinx的DDS IP核的RTL代码,一般从哪可以得到?

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发表于 2024-11-13 21:03:29 | 显示全部楼层 |阅读模式

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FPGA里面是黑盒子,RTL一般找谁可以拿到?
发表于 2024-11-13 21:18:32 | 显示全部楼层
本帖最后由 轩辕志瑜 于 2024-11-14 23:04 编辑

__________
发表于 2024-11-13 21:22:23 | 显示全部楼层
截图_2024-11-13_21-19-58.png 截图_2024-11-13_21-20-45.png 截图_2024-11-13_21-21-44.png


补充内容 (2024-12-30 22:00):
这是解密xilinx自带ip核的

点评

怎么搞到的资源  发表于 2024-12-30 16:05
 楼主| 发表于 2024-11-14 08:45:47 | 显示全部楼层

verilog的有吗?DDS Compiler模块的
发表于 2024-11-14 13:57:59 | 显示全部楼层
helimpopo 发表于 2024-11-14 08:45
verilog的有吗?DDS Compiler模块的

只有vhdl的,但你可以转换成Verilog或者直接综合成网表调用
 楼主| 发表于 2024-11-14 14:40:20 | 显示全部楼层
轩辕志瑜 发表于 2024-11-14 13:57
只有vhdl的,但你可以转换成Verilog或者直接综合成网表调用

可不可以分享一下呢?
发表于 2024-11-14 15:13:18 | 显示全部楼层
其实DDS这种模块自己RTL代码写一个也不算太难
 楼主| 发表于 2024-11-14 16:04:00 | 显示全部楼层
liuguangxi 发表于 2024-11-14 15:13
其实DDS这种模块自己RTL代码写一个也不算太难

xilinx的是两级泰勒展开,能显著降低ROM容量同时保持很高的频率分辨率
发表于 2024-11-14 16:44:34 | 显示全部楼层
helimpopo 发表于 2024-11-14 16:04
xilinx的是两级泰勒展开,能显著降低ROM容量同时保持很高的频率分辨率

算法具体的实现原理在Datasheet以及论文上都能够查到,本身不存在什么秘密。
 楼主| 发表于 2024-11-14 17:22:54 | 显示全部楼层
liuguangxi 发表于 2024-11-14 16:44
算法具体的实现原理在Datasheet以及论文上都能够查到,本身不存在什么秘密。
...

说这些,你帮我写一个行不?Datasheet也只是说一个大概。
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