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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › Analog/RF IC 设计 › Analog/RF IC 设计讨论 › LDO线性调整率问题
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查看: 652|回复: 8

[求助] LDO线性调整率问题

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zhangziyin
发表于 2024-10-23 14:48:39 | 显示全部楼层 |阅读模式
100资产

为什么我设计的LDO线性调整率这么差，是误差放大器的原因还是源随器的问题？（上是空载，下是重载）

                               
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DD_cebelas

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你power switch size 太小了, 你看EA output 已經拉接近到gnd (93mV) 讓 source follower output 卡在使power switch gate voltage 最小的情況 = Power Switch VSG 最大 = 最大輸出電流, 他還是無法sourcing 你要的最大電流~ 把power switch 加大唄 然後要流margin 給 EA output swing 因為你過惹 Source follower
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DD_cebelas
发表于 2024-10-23 14:48:40 | 显示全部楼层
你power switch size 太小了, 你看EA output 已經拉接近到gnd (93mV) 讓 source follower output 卡在使power switch gate voltage 最小的情況 = Power Switch VSG 最大 = 最大輸出電流, 他還是無法sourcing 你要的最大電流~

把power switch 加大唄 然後要流margin 給 EA output swing 因為你過惹 Source follower
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ycjack
发表于 2024-10-23 14:54:57 | 显示全部楼层
VDD=1.8V，第二级又用了source follower，看起来cascade运放输出摆幅受限进线性区了。
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zhangziyin
 楼主| 发表于 2024-10-23 15:01:24 | 显示全部楼层


ycjack 发表于 2024-10-23 14:54
VDD=1.8V，第二级又用了source follower，看起来cascade运放输出摆幅受限进线性区了。 ...


在负载电流变到140mA时，输出电压是咋变为负的九点几的
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ycjack
发表于 2024-10-23 15:18:23 | 显示全部楼层


zhangziyin 发表于 2024-10-23 15:01
在负载电流变到140mA时，输出电压是咋变为负的九点几的


运放进线性区了，环路增益没了，输出又抽电流，所以就变成负的了。
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zhangziyin
 楼主| 发表于 2024-10-23 15:31:24 | 显示全部楼层


ycjack 发表于 2024-10-23 15:18
运放进线性区了，环路增益没了，输出又抽电流，所以就变成负的了。


嗯嗯，谢谢老哥
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blue810204
发表于 2024-10-24 09:05:17 | 显示全部楼层
感觉是电流负载给的太大了，140mA
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sara9233
发表于 2024-10-24 15:28:21 | 显示全部楼层
EA的输出的source follower能不能换成nmos的，不然从EA的输出到功率管的gate经过两个vgs，驱动能力很受限的。
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zhangziyin
 楼主| 发表于 2024-10-24 16:21:06 | 显示全部楼层


blue810204 发表于 2024-10-24 09:05
感觉是电流负载给的太大了，140mA


空载的时候在VDD大于1.8V之后就稳不住了，还是EA设计的问题，摆幅不够
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