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查看: 547|回复: 3

[求助] ADC采样时钟设计

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发表于 2024-9-27 09:33:48 | 显示全部楼层 |阅读模式

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请问大家在做ADC时,采样时钟如何设计一般?我想的是通过外部差分正弦输入 转到50% 占空比方波,然后根据自己需求转换到对应占空比的方波,大家有比较好的资料推荐吗。想做的频率大概在1~2G左右

发表于 2024-9-27 11:04:20 | 显示全部楼层
采样率是1~2G?如果要分频的话,外部输入得10G左右
 楼主| 发表于 2024-9-27 14:07:27 | 显示全部楼层


ADC_coco 发表于 2024-9-27 11:04
采样率是1~2G?如果要分频的话,外部输入得10G左右


对呢,所以感觉这种方法太高了频率,可能精度啥的出来不好,想看看有更好的方法没
发表于 2024-9-27 18:29:46 | 显示全部楼层


yuanhao1024 发表于 2024-9-27 14:07
对呢,所以感觉这种方法太高了频率,可能精度啥的出来不好,想看看有更好的方法没
...


感觉得做pll吧
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