假如一个MUX有输出A,B和输出C

scutlee · 发表于 2024-8-15 11:09:37

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输入A,B有一个是clock，一个是data，由另外得信号来切换。

输出C是clock，
那么应该怎么约束呢

watertree · 发表于 2024-8-15 11:19:58

约束什么？组合逻辑，时钟不应该直接穿过去么？

scutlee · 发表于 2024-8-15 14:15:46

watertree 发表于 2024-8-15 11:19
约束什么？组合逻辑，时钟不应该直接穿过去么？

这是一个pin mux。

A和B谁是data谁是clock不确定，可以切换。
输出C就只是clock。

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[讨论] 假如一个MUX有输出A,B和输出C