verilog-top 数模混合，如何设置模拟的参考电压

Spicedog · 发表于 2024-8-1 14:45:55

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请教一下，verilog-top 数模混合（dig 做chip top，testbench是verilog），遇到一个问题————模拟电路的参考电压（比如：0.3 V）要如何加入呢？ VCS 的 Testbench 好像没法加入
模拟电压？

工大鱼肉 · 发表于 2024-8-1 15:32:31

建议用xrun+spectre，然后xrun下面有个pll例子，仿真环境还有好多文档，先跑跑看，关键字是amsdv什么的

puxiancheng · 发表于 2024-8-1 15:44:44

如果是用xa的话，看下文档。里面有讲

tapas · 发表于 2024-8-1 16:21:01

谢谢

nirvana_pear · 发表于 2024-8-1 18:29:37

dolamos · 发表于 2024-9-17 02:04:43

kan kan

[求助] verilog-top 数模混合，如何设置模拟的参考电压