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小弟在设计中遇到一麻烦,希望各位大人帮忙: 多谢!
设计的主要内容是,应用CPLD内部的分布式双口 RAM 来存储一片AD采样芯片采来的数据,待AD采样全部完成
后产生一中断信号通知主处理器(TMS320F2812)来将数据一次性读取出分布式RAM,原理图在附件中。
CPLD中的程序已经做过综合,前仿真后仿真的结果也是我期待的结果。但是在调试硬件过程中,当把分布式
RAM 的相关程序烧入 CPLD 后则无法对 TMS320F2812 作硬件仿真,而把分布式 RAM 的相关程序从工程中文件中删
除在烧入 CPLD 时则可对 TMS320F2812 作硬件仿真,并且整个硬件运行正常。 |
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基于cpld的采样电路原理图.bmp
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sampling.rar
1.43 MB, 下载次数: 98
, 下载积分:
资产 -2 信元, 下载支出 2 信元
CPLD 程序
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