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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › Analog/RF IC 设计 › Analog/RF IC 设计讨论 › 运放相位裕度问题
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查看: 395|回复: 2

[求助] 运放相位裕度问题

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muchunlin
发表于 2024-7-2 16:29:17 | 显示全部楼层 |阅读模式

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如图，仿真闭环时，运放相位裕度的曲线，请问是什么情况
1719908880458.png
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butters
发表于 2024-7-2 21:51:26 | 显示全部楼层
感觉像是次极点太近的原因，看看电路图吧
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如月肆
发表于 2024-7-2 21:57:09 | 显示全部楼层
零点导致次级点和第三极点共同作用使增益-40db/dec下降，相位-90/dec下降
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