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楼主: 知芯

[求助] LVS设置的问题吗

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发表于 2024-6-14 14:12:46 | 显示全部楼层
器件识别错误一般都是层次盖错了
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 楼主| 发表于 2024-6-14 14:13:24 | 显示全部楼层


   
知芯 发表于 2024-6-14 13:41
确实 还是要仔细检查


确实是自己的问题 哎 有时候容易被自己误导 警惕
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发表于 2024-6-14 14:13:30 | 显示全部楼层
_sup2v 串联栅极有 n 个输入引脚 IN1 ... INn 和两个输出引脚 OUT1 和 OUT2(共 n+2 个引脚),由三引脚和四引脚 MOS 器件组成,所有晶体管的基底引脚都连接到一个网,即 OUT1 或 OUT2。所有器件均为 CMOS P 型晶体管。  _smp4b 串联栅极具有 n 个输入引脚 IN1 ... INn,两个输出引脚 OUT1 和 OUT2,以及一个基底引脚 SUB(共 n+3 个引脚),由四引脚 MOS 器件组成,所有器件的基底引脚都连接到网 SUB。所有器件均为 CMOS P 型晶体管。
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 楼主| 发表于 2024-6-14 14:14:24 | 显示全部楼层
已解决,被自己误导了
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发表于 2024-6-14 14:15:01 | 显示全部楼层
依上述情况分析你的layout是哪边出错了
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 楼主| 发表于 2024-6-14 14:17:14 | 显示全部楼层


   
note30933 发表于 2024-6-14 14:13
_sup2v 串联栅极有 n 个输入引脚 IN1 ... INn 和两个输出引脚 OUT1 和 OUT2(共 n+2 个引脚),由三引脚和 ...


感谢回复 虽然这次问题的原因是我在第二组电流镜没有给衬底电位导致器件无法识别,但大哥的分析问题还是值得我学习的  谢谢!
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 楼主| 发表于 2024-6-14 14:18:12 | 显示全部楼层


   
note30933 发表于 2024-6-14 14:15
依上述情况分析你的layout是哪边出错了


是的 分析问题的能上还是有欠缺 还得多学习 多练
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发表于 2024-6-14 15:03:18 | 显示全部楼层


   
note30933 发表于 2024-6-14 14:13
_sup2v 串联栅极有 n 个输入引脚 IN1 ... INn 和两个输出引脚 OUT1 和 OUT2(共 n+2 个引脚),由三引脚和 ...



更新_sup2v , 前面的解释是笔误

_sup2v:_smpnv 的 OUT1 或 OUT2 引脚连接到电源网络。
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发表于 2024-6-14 15:06:37 | 显示全部楼层


   
note30933 发表于 2024-6-14 14:13
_sup2v 串联栅极有 n 个输入引脚 IN1 ... INn 和两个输出引脚 OUT1 和 OUT2(共 n+2 个引脚),由三引脚和 ...


更新_sup2v , 前面的解释是笔误

_sup2v:_smpnv 的 OUT1 或 OUT2 引脚连接到电源网络。
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发表于 2024-6-14 16:19:29 | 显示全部楼层
谢谢分享
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