关于LVS BOX的用法

sunhongwei · 发表于 2024-6-3 16:50:02

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本帖最后由 sunhongwei 于 2024-6-3 16:51 编辑

我现在的desgin 还缺 analog的GDS。我该怎样lvs box掉这个analog，然后check 我内部的LVS。

我试了几个方法，都不太行。

方法1：datebase 里删掉 analog 。{ 报cdl issue}
方法2：run LVS的时候， LVS BOX analog_cell analog_cell { 报所有std cell incorrect}

sunhongwei · 发表于 2024-6-13 13:38:30

解决了，我是直接在database里删掉了这个analog. 这样产的 gds和cdl 里，就都没有这个analog。
过掉了LVS

sunhongwei · 发表于 2024-6-4 10:56:44

顶一下

lixuhui112 · 发表于 2024-6-4 14:50:25

LVS BOX analog_cel 就可以我们都是这么用的

sunhongwei · 发表于 2024-6-4 15:22:10

lixuhui112 发表于 2024-6-4 14:50
LVS BOX analog_cel 就可以我们都是这么用的

这样会报 cdl missing

zhy910827 · 发表于 2024-6-4 16:45:49

印象中得有一个只有PIN的Cell才能BOX。
个人理解是需要PIN对上了才能BOX位置和上层链接关系。

你让Analog生成一个，或者自己画一个呗。

lixuhui112 · 发表于 2024-6-5 11:18:28

sunhongwei 发表于 2024-6-4 15:22
这样会报 cdl missing

你这analog_cell 的cdl 还是要添加呀，只是不检查而已

墨默 · 发表于 2024-6-11 17:14:10

出lvs用的网表时，exclude这个cell，行不行？

我本是高山 · 发表于 2024-9-19 18:06:02

请教一下，lvsbox的作用是什么呢，跟H—cell是什么区别呢

semon_lee · 发表于 2024-12-12 17:04:25

我本是高山发表于 2024-9-19 18:06
请教一下，lvsbox的作用是什么呢，跟H—cell是什么区别呢

LVS box 只是把不care 的模块或者ip 暂时屏蔽掉，一般顶层前期评估的时候会用这个方式快速检查lvs 问题

hcell的话是另一个东西，我的理解是有点类似于层级的感觉，好比如mem ，如果hcell 里不添加这个mem 的名字，刚好这个mem 上有错，工具就会报出来mem 的底层器件的错，std cell 同理，有点可以快速定位问题的感觉；还有一种说法是，hcell 可以加速lvs 的进程，但是一直不是很理解

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