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[讨论] VerilogA的开发程度

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发表于 2024-5-15 16:49:47 | 显示全部楼层 |阅读模式

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目前的VerilogA很多人都已经使用到了,其对于加快仿真进程来说是利好的,那么关于VerilogA的开发,理想的建模是很容易实现的,但建模出来的结果与实际出入可能较大,所以想询问一下,大家对于VerilogA的开发到了什么程度,非理想建模有人去尝试吗?
发表于 2024-5-15 17:24:54 | 显示全部楼层
什么样的建模算非理想建模?
 楼主| 发表于 2024-5-16 17:19:05 | 显示全部楼层


子车天纵 发表于 2024-5-15 17:24
什么样的建模算非理想建模?


我们实际使用的IP都会有各种非理想的行为,比如说运放要有带宽,功耗,比较器要有速度,失调,OSC的频率随温度的变化,BGR的温漂等等,纯理想的建模与实际的电路相差是有些大的,所以就不能仅仅通过理想建模建立的整个系统。
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