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[求助] NBTI效应与衬底电压的关系

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RFcircuits
发表于 2024-4-15 10:38:15 | 显示全部楼层 |阅读模式

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通常为了避免NBTI效应，一般是在电路diasble时把PMOS三端接到VDD，此时PMOS所有电压都是0。
那么如果把三端都接到VSS，衬底仍然是VDD，是否能避免NBIT效应呢？(有些电路并不方便做到disable的时候把PMOS三端都接到vdd)
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