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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 后端设计 › 后端讨论区 › empty module

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查看: 845|回复: 2

[求助] empty module

发表于 2024-3-13 17:52:39 | 显示全部楼层 |阅读模式

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i cc 2 中有empty module，这个必须手工删除吗？

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发表于 2024-3-14 09:58:31 | 显示全部楼层

write_verilog -exclude empty_modules

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楼主| 发表于 2024-3-14 10:31:57 | 显示全部楼层

zero_0 发表于 2024-3-14 09:58
write_verilog -exclude empty_modules

谢谢老哥，那就不用删除了，写网表的时候剔除就可以了

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