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[求助] 高频时的逻辑门转换速度不够,求助!!

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发表于 2024-3-10 21:13:14 | 显示全部楼层 |阅读模式

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(本科小白)在做分频器时 拉扎维教授文献中很喜欢用÷2÷3CELL来搭可编程分频器  在高频时 采用的TSPC结构  低频用的CMOS结构
可是复现高频的÷2÷3_TSPC_latch时 在6G左右可以分频   再高一点频率  它就不正常工作了  设置的2分频 跑仿真为4分频  
感觉原因很可能是里面的逻辑门在高频延时太高了   有什么高频的逻辑门 或者转换速度快的门结构吗(反相器,与非门-20GHz)
发表于 2024-3-11 06:52:14 来自手机 | 显示全部楼层
工艺是? 28nm tspc 10g是没有任何问题的
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发表于 2024-3-11 08:41:47 | 显示全部楼层
可以尝试下CML逻辑,CML逻辑一般能做比较高
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发表于 2024-3-11 09:49:14 | 显示全部楼层
CML latch
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 楼主| 发表于 2024-3-17 13:22:12 | 显示全部楼层


   
icdane 发表于 2024-3-11 06:52
工艺是? 28nm tspc 10g是没有任何问题的


谢谢回复!!前几天没有及时看到  用的TSMCN65
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 楼主| 发表于 2024-3-17 13:24:09 | 显示全部楼层


收到啦!!!非常感谢你
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 楼主| 发表于 2024-3-17 13:25:32 | 显示全部楼层


   
blueclothes 发表于 2024-3-11 08:41
可以尝试下CML逻辑,CML逻辑一般能做比较高


收到!!谢谢你的建议!!帮助很大
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 楼主| 发表于 2024-3-17 13:26:50 | 显示全部楼层


   
icdane 发表于 2024-3-11 06:52
工艺是? 28nm tspc 10g是没有任何问题的


嗯嗯好勒  工艺是 tsmcn65的噢  我去研究一下CML分频器
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 楼主| 发表于 2024-3-17 13:27:57 | 显示全部楼层


   
icdane 发表于 2024-3-11 06:52
工艺是? 28nm tspc 10g是没有任何问题的


TSMCN65的工艺 可恶啊
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发表于 2024-3-17 17:04:43 | 显示全部楼层
首先应该弄清楚哪条路径延时最长,限制了最大频率只能到6G。然后优化这条路径的延时。65nm的/2/3电路只跑到6GHz是不应该的。
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