《SystemVerilog数字集成电路功能验证》课件和源码（重要更新）

hithust · 发表于 2024-2-29 17:49:38

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本帖最后由 hithust 于 2024-2-29 17:51 编辑

对PPT内容和图片进行了更新，主要更新了第4章时钟块的部分内容、第5章OOP的部分图片。
阅读第4章时钟块时如果遇到困难，可以看下对应PPT，PPT中重画了更容易理解的图。
如果对书内容有疑问，可以关注公众号“学验证”留言。
另外源代码增加了一些例子，并对第9章代码进行优化。

大家直接去下载吧

链接：https://pan.baidu.com/s/1jzsqOKmDeRAVBWAY5MiXOA?pwd=1111
提取码：1111

zixin1hao · 发表于 2024-2-29 18:10:47

Thanks for sharing

skahill · 发表于 2024-3-1 08:34:39

Thanks for sharing...

伪界 · 发表于 2024-3-1 16:43:30

感谢分享

colindeng · 发表于 2024-3-7 21:54:16

感谢分享

LuckyCoCo · 发表于 2024-3-8 14:33:13

thnks for sharing

zxhxym · 发表于 2024-4-3 02:17:52

Thanks for sharing...

sutaotao2001 · 发表于 2024-4-3 12:20:38

Thanks

jiaofufu · 发表于 5 天前

非常感谢

小阳SXY · 发表于 5 天前

thanks

[原创] 《SystemVerilog数字集成电路功能验证》课件和源码（重要更新）

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