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查看: 868|回复: 7

[求助] cadence自带的d触发器输出一直不变

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发表于 2024-2-1 11:52:19 | 显示全部楼层 |阅读模式

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用cadence自带的d触发器做一些小实验,但是发现就算d一直是高电平,输出还是低电平,是为什么呢,有没有大佬帮忙看看,电路设置如图
微信图片_20240201114928.png
微信图片_20240201114915.png
微信图片_20240201114943.png
微信截图_20240201115128.png
发表于 2024-2-1 12:49:00 | 显示全部楼层
你参数没填对。
 楼主| 发表于 2024-2-1 13:07:59 | 显示全部楼层


demonhunter 发表于 2024-2-1 12:49
你参数没填对。


感谢指点!具体是哪个参数有问题呢
发表于 2024-2-1 13:57:12 | 显示全部楼层


boynextdoor 发表于 2024-2-1 13:07
感谢指点!具体是哪个参数有问题呢


vtrans=2.5,输入1V,当然是低电平。
 楼主| 发表于 2024-2-1 14:06:47 | 显示全部楼层


demonhunter 发表于 2024-2-1 13:57
vtrans=2.5,输入1V,当然是低电平。


我把时钟改成0-1方波,vtrans和vtransclk都是05,但还是不对
微信截图_20240201140329.png
微信截图_20240201140355.png
微信截图_20240201140404.png
发表于 2024-2-1 15:50:12 | 显示全部楼层
为什么会变呢,d触发器的作用就是clk沿来的读输入的值,并把它送到输出端,你不管clk什么时候来你的输入都是1,他咋变呢
发表于 2024-2-1 15:55:04 | 显示全部楼层
你至少让你的输入有点变化你才能看出输出的变化吧
 楼主| 发表于 2024-2-1 16:47:21 | 显示全部楼层


xdy609841687 发表于 2024-2-1 15:50
为什么会变呢,d触发器的作用就是clk沿来的读输入的值,并把它送到输出端,你不管clk什么时候来你的输入都 ...


我的d给的是1,但输出的q是0
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