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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › Analog/RF IC 设计 › Analog/RF IC 设计讨论 › 运放差模相位裕度仿真
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查看: 768|回复: 1

[求助] 运放差模相位裕度仿真

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发表于 2024-1-16 23:25:50 | 显示全部楼层 |阅读模式

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这样使用的运放，stb仿真差模相位裕度，结果有150°多，会有什么问题吗？
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Shiroihane
发表于 2024-1-17 09:40:41 | 显示全部楼层
相位裕度越高，环路越稳定，响应速度越慢，故一般取60°
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