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[求助] bcd工艺实现高压差间的开关

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发表于 2023-12-29 17:30:35 | 显示全部楼层 |阅读模式
500资产
190588079.jpg
图中的开关有没有可能通过BCD工艺实现?

发表于 2023-12-29 17:55:02 | 显示全部楼层
输入VGS 多少??  20v  VGS     VDS=ˋ40v ? , switch  2 40v ?
LDMOS 主要是 drain 耐高压 ,  你需   LDMOSsource 40v ,   LDNMOS source 0v  ,   LD_PMOSdrain   + LD_NMOS drain ,
这样输出端点可0~ 40v , 至于ld pmos VGS 就 40 – 20v 的 gate clamp .

 楼主| 发表于 2023-12-29 18:03:56 | 显示全部楼层
LDMOS 的VGS只有5V。。。。。。。
发表于 2023-12-29 23:04:44 | 显示全部楼层
0->40V:  LDNMOS 的 Drain
20V:       LDNMOS 的source

LDNMOS的gate 电压为: 25V(开关闭合),20V(开关打开),需要一个高压地的生成电路。

不知道这样是否可行
 楼主| 发表于 2024-1-2 16:25:27 | 显示全部楼层


hanstein 发表于 2023-12-29 23:04
0->40V:  LDNMOS 的 Drain
20V:       LDNMOS 的source


不可行,当LDNMOS 的Drain为0V时,会有大漏电。
发表于 2024-1-3 22:34:47 | 显示全部楼层


swp24551 发表于 2024-1-2 16:25
不可行,当LDNMOS 的Drain为0V时,会有大漏电。


为啥?
 楼主| 发表于 2024-1-8 13:39:58 | 显示全部楼层


普通的nmos,栅源相等,漏端低于源端,也会有电流的啊,源漏切换,PN结导通了
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