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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 后端设计 › 后端讨论区 › 请教综合问题
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查看: 795|回复: 5

[求助] 请教综合问题

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wdmzjjdeb
发表于 2023-12-28 10:06:06 | 显示全部楼层 |阅读模式

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本帖最后由 wdmzjjdeb 于 2023-12-28 10:06 编辑

在后端设计中会有一些模块，他们的关系紧密，且与外部连接较少，所以把它们划为一个harden block。

我想问的是，如果想综合一个harden block，但这个block并没有一个.v文件把各个小模块连起来，这时该如何进行综合呢？current_design该指定谁呢？

感谢解答~~
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wdmzjjdeb
 楼主| 发表于 2024-1-9 15:21:19 | 显示全部楼层
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zero_0
发表于 2024-1-9 16:13:35 | 显示全部楼层
就不能这么做，需要一个wrapper.v把它们包起来
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wdmzjjdeb
 楼主| 发表于 2024-1-9 17:00:19 | 显示全部楼层


zero_0 发表于 2024-1-9 16:13
就不能这么做，需要一个wrapper.v把它们包起来


请问这个文件的内容是各个rtl的路径吗？
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zero_0
发表于 2024-1-9 18:01:25 | 显示全部楼层


wdmzjjdeb 发表于 2024-1-9 17:00
请问这个文件的内容是各个rtl的路径吗？


不是，你说的是filelist了

我说的是一个harden必须要有一个top module把各个小模块包起来
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wdmzjjdeb
 楼主| 发表于 2024-1-10 09:26:55 | 显示全部楼层


zero_0 发表于 2024-1-9 18:01
不是，你说的是filelist了

我说的是一个harden必须要有一个top module把各个小模块包起来


嗯嗯明白了，之前一直不确定。感谢！
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