这个是什么error

gdz_011806 · 发表于 2023-8-29 15:33:19

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小弟在做顶层物理验证的时候，输入了网表（顶层的网表）版图是只有模拟模块，pad，sram flash，电源地的连线和模拟模块的走线，没有放数字模块，数字模块之间的连线和模拟之间的连线，用gui界面跑会有这个问题，cdl不变，加上数字模块，数字模块之间的连线和模拟之间的连线就好了

石头遇见雪 · 发表于 2023-8-29 15:33:20

把runset 路径下的所有之前缓存的数据都删掉，在跑一次就好了

fengrlove · 发表于 2023-8-29 16:31:07

没有 pin label

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