请教大家，怎么带子模块的失调跑仿真

LDDD1997 · 发表于 2023-8-8 15:11:40

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本帖最后由 LDDD1997 于 2023-8-8 15:14 编辑

请教大家，怎么带图中某一子模块的失调跑仿真。
减法器，tia和比较器都会有失调，做失调消除该在那里做呢？

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Rabbit_CHAN · 发表于 2023-8-8 15:50:08

可以尝试在输入端串接一个 dc 源来模拟 Vos？

LDDD1997 · 发表于 2023-8-8 16:46:32

Rabbit_CHAN 发表于 2023-8-8 15:50
可以尝试在输入端串接一个 dc 源来模拟 Vos？

你好，是需要是先mc仿真，再根据失调加vdc吧

Rabbit_CHAN · 发表于 2023-8-8 17:04:58

LDDD1997 发表于 2023-8-8 16:46
你好，是需要是先mc仿真，再根据失调加vdc吧

可以这么理解。不过刚刚想到，其实你还可以在 mc 的时候设定只考虑某一模块，在 mc 设置面板可以 specific subcircuit

LDDD1997 · 发表于 2023-8-8 17:19:51

本帖最后由 LDDD1997 于 2023-8-9 08:50 编辑

Rabbit_CHAN 发表于 2023-8-8 17:04
可以这么理解。不过刚刚想到，其实你还可以在 mc 的时候设定只考虑某一模块，在 mc 设置面板可以 specifi ...

你好，我想问的就是你说的 “只考虑某个模块mc” ，是这个地方吧

LDDD1997 · 发表于 2023-8-8 17:22:50

本帖最后由 LDDD1997 于 2023-8-9 08:55 编辑

Rabbit_CHAN 发表于 2023-8-8 17:04
可以这么理解。不过刚刚想到，其实你还可以在 mc 的时候设定只考虑某一模块，在 mc 设置面板可以 specifi ...

你好，你说的是这个地方吧

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Rabbit_CHAN · 发表于 2023-8-10 09:43:16

LDDD1997 发表于 2023-8-8 17:22
你好，你说的是这个地方吧

嗯，是的，具体用法的话你自己多点点、多试试就清楚了

LDDD1997 · 发表于 2023-8-10 13:44:45

Rabbit_CHAN 发表于 2023-8-10 09:43
嗯，是的，具体用法的话你自己多点点、多试试就清楚了

好的谢谢

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