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查看: 1179|回复: 13

求助使用IC618与calibre内嵌lvs时出现难以理解的问题

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发表于 2023-8-2 14:33:53 | 显示全部楼层 |阅读模式

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我使用GF180nm的库创建了一个反相器的原理图,前仿真没问题,然后绘制layout如图,DRC检查时只有密度错误,但是在LVS中各个port均未识别出,,。sp文件见附件
在最后显示各个port均未识别出,只有1,2,3,4




请问有人知道为什么吗

LVS报错

LVS报错

Layout

Layout

原理图

原理图

inverter.sp.txt

1.5 KB, 下载次数: 0 , 下载积分: 资产 -2 信元, 下载支出 2 信元

 楼主| 发表于 2023-8-2 14:35:39 | 显示全部楼层
啊第一次使用EETOP,.sp文件如下:
.SUBCKT nmosvar_3p3 G D SX
.ENDS
***************************************
.SUBCKT pnvar_1p8 PD NW SX
.ENDS
***************************************
.SUBCKT RFNMOS_1P8 D G S B
.ENDS
***************************************
.SUBCKT RFPMOS_1P8 D G S B
.ENDS
***************************************
.SUBCKT RFNMOS_3P3 D G S B
.ENDS
***************************************
.SUBCKT RFPMOS_3P3 D G S B
.ENDS
***************************************
.SUBCKT PNVAR_1p8V_rf pd nw sx
.ENDS
***************************************
.SUBCKT NMOSVAR_1p8V_rf G D SX
.ENDS
***************************************
.SUBCKT NMOSVAR_3p3V_rf G D SX
.ENDS
***************************************
.SUBCKT PNVAR_3p3V_rf pd nw sx
.ENDS
***************************************
.SUBCKT dnw pw tw sx
.ENDS
***************************************
.SUBCKT dnw_p pw tw sx
.ENDS
***************************************
.SUBCKT MIM_018IC TOP BOT SUB
.ENDS
***************************************
.SUBCKT inverter
** N=4 EP=0 IP=0 FDC=3
M0 4 1 3 3 nmos_1p8 L=1.8e-07 W=4.6e-07 AD=2.208e-13 AS=2.208e-13 PD=1.88e-06 PS=1.88e-06 NRD=1.04348 NRS=1.04348 m=1 par=1 $X=1410 $Y=-6880 $D=0
M1 4 1 2 2 pmos_1p8 L=1.8e-07 W=4.6e-07 AD=2.208e-13 AS=2.208e-13 PD=1.88e-06 PS=1.88e-06 NRD=1.04348 NRS=1.04348 m=1 par=1 $X=1410 $Y=-4760 $D=2
D2 3 2 nwp_p AREA=1.6956e-11 PJ=1.999e-05 m=1 $X=-350 $Y=-4005 $D=32
.ENDS
***************************************
发表于 2023-8-2 14:47:07 | 显示全部楼层
label 你打了么?
 楼主| 发表于 2023-8-2 14:51:46 | 显示全部楼层


fengrlove 发表于 2023-8-2 14:47
label 你打了么?


呜。这样算打了吗,我不确定label是否是对应层的

                               
登录/注册后可看大图
,但还是只有1 2 3 4
发表于 2023-8-2 14:58:38 | 显示全部楼层
网表是  VDD 你layout上好像都是小写
 楼主| 发表于 2023-8-2 15:02:42 | 显示全部楼层


FOREVER10 发表于 2023-8-2 14:58
网表是  VDD 你layout上好像都是小写


我改成全大写似乎也不行
 楼主| 发表于 2023-8-2 15:03:27 | 显示全部楼层


fengrlove 发表于 2023-8-2 14:47
label 你打了么?


我generate的时候自动生成了
 楼主| 发表于 2023-8-2 15:12:59 | 显示全部楼层
我有一份有用的db文件但我不理解为什么有问题
 楼主| 发表于 2023-8-2 15:14:11 | 显示全部楼层
实际上我原本成功了一次,但是在我修改MOS管宽长比后,修改版图后便出现了这个问题,我lvs时指定原来的db文件就没有问题
发表于 2023-8-2 15:24:34 | 显示全部楼层
你的 Nsub 怎么没有在 newll里面?
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