Routing绕不通，发现在fp阶段出现了几个Warring，但是找不到解决方法

IC后端小楠 · 发表于 2023-7-23 21:03:53

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上图是我的fp以及这几个Warring的介绍，列出来的这几个pin脚是PAD内部的，不明白为啥会报出这种warring，可能是什么原因造成的呢

voiluce · 发表于 2023-7-24 09:19:02

看看出pin 是不是没有拉到 cell boundary ？

sjtusonic · 发表于 2023-7-24 09:24:44

这些pins看起来尺寸很大啊，这是在哪层layer？
有signal net连到这些pin上面吗？
IP的documents有没有描述这些pin的用途？

lzqxiang · 发表于 2023-7-24 09:28:26

是不是被routeblk挡住了？

IC后端小楠 · 发表于 2023-7-24 10:08:28

voiluce 发表于 2023-7-24 09:19
看看出pin 是不是没有拉到 cell boundary ？

请问这个怎么看可以详细介绍一下吗，谢谢你

IC后端小楠 · 发表于 2023-7-24 10:10:31

lzqxiang 发表于 2023-7-24 09:28
是不是被routeblk挡住了？

我man了一下这个Warring，意思就是说与这个pin脚的连线穿过了blockage，但不知道这个blockage在哪里，我也没设置过

lzqxiang · 发表于 2023-7-24 10:13:19

IC后端小楠发表于 2023-7-24 10:10
我man了一下这个Warring，意思就是说与这个pin脚的连线穿过了blockage，但不知道这个blockage在哪里，我 ...

你看一下这个block出pin的地方

IC后端小楠 · 发表于 2023-7-24 10:15:55

sjtusonic 发表于 2023-7-24 09:24
这些pins看起来尺寸很大啊，这是在哪层layer？
有signal net连到这些pin上面吗？
IP的documents有没有描述 ...

Warring中报出的这些pin脚都是PAD内部的如下图红圈标出位置，layer在M5，有signal net连到这些pin上面的

sjtusonic · 发表于 2023-7-24 13:13:32

IC后端小楠发表于 2023-7-24 10:15
Warring中报出的这些pin脚都是PAD内部的如下图红圈标出位置，layer在M5，有signal net连到这些pin上面的 ...

你的工艺一共用几层layer？从形状上看像不像是IP往上连的RDL层？

IC后端小楠 · 发表于 2023-7-24 13:52:56

本帖最后由 IC后端小楠于 2023-7-24 14:07 编辑

sjtusonic 发表于 2023-7-24 13:13
你的工艺一共用几层layer？从形状上看像不像是IP往上连的RDL层？

用的1p11m，11层金属，我这个是模块，这个RDL层也还没用到

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