verdi仿真问题

Marion_ · 发表于 2023-7-18 21:00:18

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Verdi加载波形后，用`define定义的位宽信号，在rtl source中加波形，显示的就是【1：0】，在波形上用get signal显示的就是`define定义的位宽，请问是为什么？

Emmet_73 · 发表于 2023-7-19 14:37:37

没理解，你定义的2bit，显示的是2bit，不就是这样吗？

gaurson · 发表于 2023-7-19 18:26:51

打开verdi的时候，它也需要编译，你要在verdi命令后加上宏定义，verdi才会认。

Marion_ · 发表于 2023-7-21 20:19:21

gaurson 发表于 2023-7-19 18:26
打开verdi的时候，它也需要编译，你要在verdi命令后加上宏定义，verdi才会认。 ...

感谢！试了一下是这样的。

Marion_ · 发表于 2023-7-21 20:23:13

Emmet_73 发表于 2023-7-19 14:37
没理解，你定义的2bit，显示的是2bit，不就是这样吗？

define定义的可能是【7：0】,但是打开verdi，在src中ctrl+w添加波形就是【1：0】。在verdi命令添加define的option就可以了。

gaurson · 发表于 2023-7-24 18:22:28

你只要理解verdi也需要编译代码这个原理就明白问题所在了。仿真工具和verdi要保证吃的是相同的filelist和宏定义。

Marion_ · 发表于 2023-7-26 15:20:19

gaurson 发表于 2023-7-24 18:22
你只要理解verdi也需要编译代码这个原理就明白问题所在了。仿真工具和verdi要保证吃的是相同的filelist和宏 ...

谢谢！

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