SRAM如何对AXI 的读交织数据进行重排？

modoalos · 发表于 2023-7-8 20:08:25

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本帖最后由 modoalos 于 2023-7-9 15:25 编辑

如题，AXI总线为128bit宽，如果用一个同样16个8bit宽的SRAM接收AXI读交织数据，我的思路是用不同的地址空间存储不同ID的数据，通过数据的size选择每次使能几个SRAM来接收数据，但假如一个burst的大小甚至够128bit，假设每个burst的size为32bit，len为2，那么可能两个burst共享一个地址，而且也不知道什么时候填完这个地址。会出现这种情况吗？如果考虑这种情况的话，应该怎么解决？

rocsman · 发表于 2023-8-4 23:41:18

不太清楚

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