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查看: 1934|回复: 9

[求助] 求检查layout中单个via的方法

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发表于 2023-6-8 13:58:42 | 显示全部楼层 |阅读模式

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[color=rgba(0, 0, 0, 0.9)]在layout中,为了提高芯片良率,模拟部分的Layout至少需要打两个Via,而代工厂给我们的DRC cmd file,没有检查单个Via的语句。蹲一个大神。

[color=rgba(0, 0, 0, 0.9)]

 楼主| 发表于 2023-6-8 14:14:53 | 显示全部楼层
发表于 2023-6-8 14:20:19 | 显示全部楼层
1 check single的V1
single_via_v1 {
  (M1 and M2) interact V1 == 1
}
加上interact 的限定条件判断只有一个V1 的位置。

     有时候fab 会提供两种via 一种square via 一种rectangle via ,其实单个rectangle的via 并不会带来process risk,那我们怎么把这种情况filter呢,可以再加一条判断,比如:

2 只check 单个的正方形via
single_square_via_v1 {
   SV1 = rectangle V1 aspect ==1
  (M1 and M2) interact SV1 == 1
}
rectangle 命令先对V1 进行筛选,就可以先filter掉矩形的via ,保留square via。即可完成对结果的筛选。
      
 楼主| 发表于 2023-6-8 14:54:55 | 显示全部楼层


ljh065216 发表于 2023-6-8 14:20
1 check single的V1
single_via_v1 {
  (M1 and M2) interact V1 == 1


添加到drc rule 的V1 check部分,跑drc会报error (this rulecheck statement will never generate output)
发表于 2023-6-8 15:11:31 | 显示全部楼层


chrisliangh 发表于 2023-6-8 14:54
添加到drc rule 的V1 check部分,跑drc会报error (this rulecheck statement will never generate outpu ...


首先层次名要改成你pdk对应的名字,让后要看podk cmd file怎么写的,有些rule用的宏来给rule分类,在一开始定义这些开哪些关,这个其实我也不太懂,自己加rule也遇到跑不了的情况
发表于 2023-6-8 15:16:20 | 显示全部楼层
刚刚检查完,用shift+s搜索就可以检查C:\Users\21046\Pictures\Screenshots
发表于 2023-6-8 15:17:27 | 显示全部楼层
提示的error是没有产生输出,但是楼上提供的写法 是有输出的。

看一下layer有没有都对应上,用的rule file是 svrf 还是 tvf 格式的
发表于 2023-6-8 15:17:55 | 显示全部楼层


l_Qingf 发表于 2023-6-8 15:16
刚刚检查完,用shift+s搜索就可以检查


如图,这样选择option,也可以直接选择via1或者via2
1686208539470.jpg
 楼主| 发表于 2023-6-8 15:28:17 | 显示全部楼层


ljh065216 发表于 2023-6-8 15:11
首先层次名要改成你pdk对应的名字,让后要看podk cmd file怎么写的,有些rule用的宏来给rule分类,在一开 ...


我看我的rule里面用了@ 然后加上之后就是没有输出,不加@ 的话就是无效参数
发表于 2023-6-8 17:10:38 | 显示全部楼层


l_Qingf 发表于 2023-6-8 15:17
如图,这样选择option,也可以直接选择via1或者via2


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