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[原创] 带隙基准上电问题

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发表于 2023-5-29 23:24:58 | 显示全部楼层 |阅读模式

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带隙基准上电问题,电路为一个电流模结构,运放采用二级OTA,电路上电过程运放两个输入不同步,导致了BGR输出有一个大的过冲,不知道是为什么,以及如何解决,特此求教
屏幕截图 2023-05-29 232047.png
屏幕截图 2023-05-29 232123.png
屏幕截图 2023-05-29 232252.png
发表于 2023-5-30 10:25:11 | 显示全部楼层
本帖最后由 自由的路飞 于 2023-5-30 10:27 编辑

你这个相位裕度多少?
发表于 2023-5-30 10:26:28 | 显示全部楼层
你这个电路的宽长比设计也不合理 说明你拉扎维前几章没看懂
发表于 2023-5-30 10:40:30 | 显示全部楼层
有点过冲是正常的
 楼主| 发表于 2023-5-30 12:56:54 | 显示全部楼层


自由的路飞 发表于 2023-5-30 10:25
你这个相位裕度多少?


60左右

 楼主| 发表于 2023-5-30 12:59:34 | 显示全部楼层


自由的路飞 发表于 2023-5-30 10:26
你这个电路的宽长比设计也不合理 说明你拉扎维前几章没看懂


啥意思嘞,指运放里的倒比管?
 楼主| 发表于 2023-5-30 13:00:29 | 显示全部楼层


moonwpf 发表于 2023-5-30 10:40
有点过冲是正常的


有点大了
发表于 2023-5-30 14:06:49 | 显示全部楼层


zhuL 发表于 2023-5-30 12:59
啥意思嘞,指运放里的倒比管?


你把M32的宽长比设置成1:10试试  看看还有没有过冲
 楼主| 发表于 2023-5-30 14:15:11 | 显示全部楼层


自由的路飞 发表于 2023-5-30 14:06
你把M32的宽长比设置成1:10试试  看看还有没有过冲


跟启动电路应该没关系,去掉启动电路波形是一样的
发表于 2023-5-30 15:16:09 | 显示全部楼层
两种解决方法可以尝试,1)在M32漏端串一个mos diode, 但要注意串完以后的简并点问题;2)在M2 gate端加大的mos电容。
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