stdcell overlap

shannon_z · 发表于 2023-3-28 17:02:04

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请教大佬，绕线完后发现时钟树上的reg 有overlap，reg都是fixed状态
什么原因引起的overlap，怎么解

maomao198477 · 发表于 2023-3-28 17:28:12

扩大面积试试

allenzhangddd · 发表于 2023-3-28 17:49:08

route opt插入的cell导致的overlap吗？

voiluce · 发表于 2023-3-28 21:17:58

多半是修timing ，size 之后造成吧 ~~~

shannon_z · 发表于 2023-3-28 22:01:16

allenzhangddd 发表于 2023-3-28 17:49
route opt插入的cell导致的overlap吗？

cts跑完之后有的，因为是fixed状态，route之后也没解掉

shannon_z · 发表于 2023-3-28 22:02:38

voiluce 发表于 2023-3-28 21:17
多半是修timing ，size 之后造成吧 ~~~

还没到修timing那块，在innovus里面，跑完cts冒出来的，感觉是做时钟树有点问题

shannon_z · 发表于 2023-3-28 22:05:58

maomao198477 发表于 2023-3-28 17:28
扩大面积试试

利用率也不高，23% 看着是有空间放的

voiluce · 发表于 2023-3-29 00:05:49

不多的话手工挪一下，要是多的话要仔细找一下原因，或者加个optdesign

suzhouwuyanzu · 发表于 2023-3-29 10:48:21

改softfixed再跑一下，或者设个dont touch

兔子IC · 发表于 2023-3-29 14:21:09

suzhouwuyanzu 发表于 2023-3-29 10:48
改softfixed再跑一下，或者设个dont touch

为什么要改softfixed再跑一下，或者设个dont touch？

这种工具没有做legli，还是要看下flow是不是有问题

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