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查看: 1806|回复: 7

[讨论] PLL的相位差问题

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发表于 2023-3-15 10:22:56 | 显示全部楼层 |阅读模式

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PLL锁定时,PFD的输入还有相位差吗?电荷泵还有电流输出吗?
发表于 2023-3-15 10:59:33 | 显示全部楼层
J我也学习一下
发表于 2023-3-15 14:33:11 | 显示全部楼层
謝謝分享~~~
发表于 2023-3-15 18:15:10 | 显示全部楼层
Thanks a lot
发表于 2023-3-16 15:22:08 | 显示全部楼层
本帖最后由 lj_hxc 于 2023-3-16 15:52 编辑

这是两个问题,首先,锁定是否存在相差,这与PLL结构相关,如果是I型的PLL,可能会存在一个稳态的相差的,但是对其微分后频率是没有频差的,这也是为什么选择锁相的一个原因,如果是II型的PLL,即使频率阶跃,相差都为零,所以通常是没有相差,当然极其恶劣情况,频率加速度输入也是存在的;至于,CP是否存在电流输出,首先,如果存在相差肯定会有电流,其次,现在很多PFDCP,为了消除鉴相死去,会设计一段区间使CP开关同时导通,如果CP的匹配做得不是很好,即使在相差为零时,也会有一定失配电流,当然,这也是CP需要解决的主要问题。
发表于 2023-3-19 04:58:08 | 显示全部楼层
我也學習一下
发表于 2023-3-19 10:23:55 | 显示全部楼层
感谢楼主分享!
 楼主| 发表于 2023-4-12 09:16:19 | 显示全部楼层


lj_hxc 发表于 2023-3-16 15:22
这是两个问题,首先,锁定是否存在相差,这与PLL结构相关,如果是I型的PLL,可能会存在一个稳态的相差的, ...


谢谢,总结的不错
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