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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 后端设计 › 后端讨论区 › CDL/SP SpiceIn问题
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查看: 1491|回复: 6

[求助] CDL/SP SpiceIn问题

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highflyer2014
发表于 2023-1-12 12:34:21 | 显示全部楼层 |阅读模式

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各位大佬，请问一下IO PAD IP中CDL/SP文件中的空连接是怎么处理的？SP文件定义的空连接PAD如下：
.SUBCKT PDIODE8SR
.ENDS
SpiceIn报错如下：
ERROR(CONN2SCH-200):The cell view PDIODE8SR does not have connectivity information.Therefore unable to create schematic for this cell view.Exiting...

非常感谢。
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voiluce
发表于 2023-1-16 10:25:51 | 显示全部楼层
这是空的cdl， 应该不太好spice in
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highflyer2014
 楼主| 发表于 2023-1-16 11:34:06 | 显示全部楼层


voiluce 发表于 2023-1-16 10:25
这是空的cdl， 应该不太好spice in


是空的cell，但是foundry将空的cell放在sp/cdl文件里面有什么作用，spince in时是否需要对空cell进行删除？您在遇到这种问题的时候通常做法是什么？谢谢。
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voiluce
发表于 2023-1-16 17:18:39 | 显示全部楼层
这个pad 是metal only， 不需要做 spicein
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菜鸟一号
发表于 2023-1-17 09:55:10 | 显示全部楼层
自己写一个啊
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highflyer2014
 楼主| 发表于 2023-1-18 21:47:33 | 显示全部楼层


voiluce 发表于 2023-1-16 17:18
这个pad 是metal only， 不需要做 spicein


我直接把此pad屏蔽了，没有spicein。
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highflyer2014
 楼主| 发表于 2023-1-18 21:48:59 | 显示全部楼层


菜鸟一号 发表于 2023-1-17 09:55
自己写一个啊


我直接把此pad屏蔽了，没有spicein。自己写一些信号连接关系么？这个pad本身是没有pin的，如果要自己加上pin，那LEF文件也要加上一样的pin信息吧。
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