如何在ASIC中存储大量数据（ram）

顾北 · 发表于 2022-8-25 16:51:07

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在设计ASIC的过程中，发现需要一个1.6M左右的数据存储，如果在verilog中用memory来写的话，会在design_vision中DC综合的时候卡住，综合不出来(可能因为量太大了？)。
想问一下有没有第三方软件可以辅助生成ram的（linux系统，180nm工艺）
（听老师说memory compiler没有180nm工艺的）

thjan65 · 发表于 2022-8-25 20:56:31

Artisan memory compiler 有180nm.

tinytera · 发表于 2022-8-26 09:09:59

1.6MB 太大了，180nm不合适用这个大的SRAM

顾北 · 发表于 2022-8-30 15:40:08

thjan65 发表于 2022-8-25 20:56
Artisan memory compiler 有180nm.

Artisan memory compiler在哪里下载呀？

顾北 · 发表于 2022-8-30 15:45:44

tinytera 发表于 2022-8-26 09:09
1.6MB 太大了，180nm不合适用这个大的SRAM

没办法，学校只有180nm的，SRAM想想办法倒是可以降低到0.8M

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