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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › Analog Layout（版图） › Layout资料区 › smic55lf库缺少validlayer和validvia

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查看: 2189|回复: 6

[求助] smic55lf库缺少validlayer和validvia

发表于 2022-7-12 22:17:51 | 显示全部楼层 |阅读模式

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本人最近装了IC617进行模拟IC学习，但是在创建layout的过程中提示no constraint groups have valid layer and valid via constraint defined.
感觉是库的安装路径出现了问题，导致connectivity generate from source之后没有MOSFET，via，metal，sub等等选项。
想问问大家解决办法。

图片.png

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下载的smic55lf是有layout信息的。
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pdk的添加是在library path中添加pdk的地址。
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楼主| 发表于 2022-7-12 22:24:58 | 显示全部楼层

本人使用的smic55lf pdk

12.06 KB, 下载次数: 80 , 下载积分: 资产 -2 信元, 下载支出 2 信元

售价: 5 信元资产 [记录]

smic55lf pdk

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楼主| 发表于 2022-7-14 19:39:29 | 显示全部楼层

顶，大家帮一下忙

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发表于 2022-7-15 13:23:31 | 显示全部楼层

你当前操作的库attachsmic55工艺库了么

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楼主| 发表于 2022-7-15 22:31:20 | 显示全部楼层

光非发表于 2022-7-15 13:23
你当前操作的库attachsmic55工艺库了么

您好，请问是lib里添加smic55的工艺库吗？我lib里通过path添加了smic55的位置，然后在lib里可以画schematic，也可以仿真，但是画不了layout。
图片.png

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发表于 2023-3-9 17:59:22 | 显示全部楼层

感谢分享PDK

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发表于 2023-4-15 01:33:43 来自手机 | 显示全部楼层

你好我用这个库发现libinit文件load不了请问你有解决方案吗

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