电压模buck的EA该如何设计？

heshibao · 发表于 2022-7-7 10:15:45

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最近仿真发现：

在电压模buck中，按照如上设计：
（1）在软启动阶段，Vsoft缓慢上升；

（2）en_bg信号OK后，Vref正常建立；
目前存在的问题是：
eaout瞬间被拉到Vdd，EA在环路中不起作用；导致此时只能靠Vsoft和sawtooth通过比较器进行环路调节。仿真Vout波形很难看。
是否应该将eaout钳位？

DD_cebelas · 发表于 2022-7-10 19:53:04

我們是做clamp EAO並沒有去特別clamp comparator output,

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