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[原创] 帮忙分析下这个LDO电路

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发表于 2022-7-5 17:24:32 | 显示全部楼层 |阅读模式

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XDJM,有熟悉这种结构的LDO的吗?不知道这样设计的优势在哪里,帮忙分析下,或者推荐一份资料也行。谢谢啦
ldo.png
发表于 2022-7-6 08:41:40 | 显示全部楼层
本帖最后由 xuwenwei 于 2022-7-6 08:57 编辑

看不懂,也看不到vref在哪里,感觉这个像是LDO中的补偿电路
 楼主| 发表于 2022-7-6 08:57:18 | 显示全部楼层


xuwenwei 发表于 2022-7-6 08:41
看不懂,也看不到vref在哪里


M7的gate是输入
发表于 2022-7-6 09:37:42 | 显示全部楼层
这种图应该拿什么画
 楼主| 发表于 2022-7-6 09:51:48 | 显示全部楼层


SKO 发表于 2022-7-6 09:37
这种图应该拿什么画


viso
发表于 2022-7-6 10:00:24 | 显示全部楼层
本帖最后由 luminedinburgh 于 2022-7-6 10:38 编辑

Casode米勒,动态补零,同时有Souce/Drain的能力,M3的增益被R1限制低阻驱动输出管M6,主要的反馈工作在LDO下PSR可能很好?不知道VOUT和VREF的比例关系怎确定/似乎是加减几个Vth? 是不是为了兼容SPI/I2C接口不同逻辑电平做的LDO?有空仿仿看

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补充,输出原来是VIN+Vth(M7),做一个SUB-REGULATOR很好啊,又简单功能又全,说不定还自带限流,这么好的电路不会有专利吧

 楼主| 发表于 2022-7-6 11:22:50 | 显示全部楼层


luminedinburgh 发表于 2022-7-6 10:00
Casode米勒,动态补零,同时有Souce/Drain的能力,M3的增益被R1限制低阻驱动输出管M6,主要的反馈工作在LDO ...


零点是补偿哪个几点的?里面的环路怎么推的?这样设计环路基于哪些指标考虑的?同时具有Source/Drain的能力,怎么理解?
发表于 2022-7-6 12:49:08 | 显示全部楼层
supper source follower
发表于 2022-7-6 12:51:57 | 显示全部楼层
DDR source sink Termination Regulator  LDO ??



发表于 2022-7-6 13:31:45 | 显示全部楼层
M7,M9构成源级跟随器,M7,M2,M3,M6形成负反馈环路进一步减小输出阻抗;
M10,M11,M9是正反馈环路,不知道目的是什么;
补偿也没看懂
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