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[求助] 全网求图:带DNW的inv的剖面图,像华虹DR里画的一样

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发表于 2022-6-29 02:57:56 | 显示全部楼层 |阅读模式

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全网求图:带DNW的inv的剖面图,像华虹DR里画的一样

全网求图:带DNW的inv的剖面图,像华虹DR里画的一样

全网求图:带DNW的inv的剖面图,像华虹DR里画的一样





发表于 2022-6-29 08:49:43 | 显示全部楼层
书上这不是有现成的吗
1111111111.jpg
 楼主| 发表于 2022-6-30 00:08:24 | 显示全部楼层


fengrlove 发表于 2022-6-29 08:49
书上这不是有现成的吗


多谢多谢,但有点瑕疵,DNW那边没画上NW,看起来没围成环,还是谢谢你
发表于 2023-5-13 21:44:52 | 显示全部楼层


fengrlove 发表于 2022-6-29 08:49
书上这不是有现成的吗


请问下这是什么书
发表于 2023-5-14 06:41:03 | 显示全部楼层


俞木逢朝 发表于 2023-5-13 21:44
请问下这是什么书


温德通的书
发表于 2024-1-25 14:53:30 | 显示全部楼层


想请教下,DNW的面积如果过大,会对芯片有什么影响呢?感谢~
发表于 2024-1-25 19:00:55 | 显示全部楼层


wengege_2020092 发表于 2024-1-25 14:53
想请教下,DNW的面积如果过大,会对芯片有什么影响呢?感谢~


怎么个大法?  就是浪费面积。。
发表于 2024-1-26 08:56:23 | 显示全部楼层


fengrlove 发表于 2024-1-25 19:00
怎么个大法?  就是浪费面积。。


领导要求成片的DNW面积尽量不要超过50*50,说是对ESD有影响,具体啥影响没说,让我自己想,自己查资料,没想明白啊~
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