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[求助] 工程实践中,建立保持时间slack为负的多少,就可能会影响电路工作的稳定性

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发表于 2022-4-4 23:05:11 | 显示全部楼层 |阅读模式

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或者说和时钟的相对大小关系是什么样呢?
是不是相比于建立时间裕量为负,保持时间裕量为负对电路工作的稳定性影响更大呢?
发表于 2022-4-5 15:47:48 | 显示全部楼层
fab提供的sign off guide内,会有针对其工艺的margin标准;
发表于 2022-4-5 15:49:21 | 显示全部楼层
这个不是模拟的相位裕度,setup为负,就意味着无法在约束的时钟下工作;
发表于 2022-4-13 09:53:22 | 显示全部楼层
负的就意味着肯定不能正常工作
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