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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › Analog/RF IC 设计 › Analog/RF IC 设计讨论 › 两级运放过冲优化问题
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查看: 2581|回复: 5

[求助] 两级运放过冲优化问题

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cc95228
发表于 2022-3-5 20:45:01 | 显示全部楼层 |阅读模式

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如图所示两级运放，反相端与输出相接，输入加阶跃，发现若干现象想请教一下原因：
1. 阶跃幅度为50mV时，过冲有15mV。但阶跃幅度为400mV时，过冲有150mV。为何阶跃幅度越大，过冲越大？
2. 为何增加M5的电流，会恶化过冲？
3. 为何增加M7的电流，会极大的减轻过冲现象？  （但增加M6的宽长比，过冲会稍微恶化一点）

以上实验实验相位裕度均控制在80°以上，Cc与CL均为1pF，GBW在40M~50MHz（改变M5电流），过冲波形大致如下图所示。
3ddb06ad075107d6748bf9b0c6d2815.png

恳请指教，不胜感激~
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gaojun927
发表于 2022-3-6 15:21:22 | 显示全部楼层
进入非线性状态了，所以小信号分析失灵。具体来说上升的时候靠M7上拉，但是M7电流有限，还要从电容去M4，就有slew了。slew使得整个环路的反馈失灵，有了一定的延迟，自然就有了过冲。等slew结束，反向建立，所以你看上面的波形反过来看是很好的阶跃响应曲线。
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cc95228
 楼主| 发表于 2022-3-6 19:03:41 | 显示全部楼层


gaojun927 发表于 2022-3-6 15:21
进入非线性状态了，所以小信号分析失灵。具体来说上升的时候靠M7上拉，但是M7电流有限，还要从电容去M4，就 ...


感谢回复~ 请问您说的“还要从电容去M4”是什么意思呀。
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tStone
发表于 2022-3-6 21:27:29 | 显示全部楼层
波特图打出来看一下，PM在80以上还有过充，猜测是Gain Margin不够，是不是产生共轭极点了？
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magicdog
发表于 2022-3-7 17:57:48 | 显示全部楼层
老弟，看下slew rate，你给的这个激励的dv/dt有点大了
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Frank大魔王
发表于 2023-9-13 17:30:37 | 显示全部楼层


gaojun927 发表于 2022-3-6 15:21
进入非线性状态了，所以小信号分析失灵。具体来说上升的时候靠M7上拉，但是M7电流有限，还要从电容去M4，就 ...


你说的真**的好
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