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查看: 1350|回复: 9

[求助] LVS错误,ICC输出gds文件在calibre里做LVS不通过

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发表于 2022-3-2 09:32:33 | 显示全部楼层 |阅读模式

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工艺tsmc018,错误全部集中在pad上,关于net的错误是对半分的,一半是版图有网表没有一半是网表有版图没有,错误都在下图显示的pad的内部,流片日期将近,请各位大神帮忙,感谢!
}8WB{NRM_I~XV@LV7Z7B1]M.png
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 楼主| 发表于 2022-3-2 09:49:33 | 显示全部楼层
关于net所有的问题都在说这个B776_PREDRV里面的连线找不到,不知道原因...
P_MMY}SKNSOQ3FQA[`903H5.png
发表于 2022-3-2 10:12:31 | 显示全部楼层
可以远程的话 我可以帮你看看
 楼主| 发表于 2022-3-2 10:39:21 | 显示全部楼层


maomao198477 发表于 2022-3-2 10:12
可以远程的话 我可以帮你看看


感谢您的好意,但是不能,项目跟教研室利益挂钩,不能外露...
 楼主| 发表于 2022-3-2 10:40:34 | 显示全部楼层
对应到网表里面提出来的原理图大概是这样的,对应有B776那个器件的pad
_A}[]QYNOKT(@{KW{[1AC$W.png
发表于 2022-3-2 12:23:47 | 显示全部楼层
单个pad lvs能不能过
带hcell 跑lvs
发表于 2022-3-2 13:29:52 | 显示全部楼层
个人的思路:按照你的说法,感觉是因为版图的连线出了问题,请检查一下版图中的这根线(你在图中看到schematic有layout没有)的这个连线。确定是否有短接或者命名错误。
 楼主| 发表于 2022-3-2 13:33:50 | 显示全部楼层


omityoung 发表于 2022-3-2 12:23
单个pad lvs能不能过
带hcell 跑lvs


单个pad可以通过,我同教研室的同学是在cadence里用模拟方法建立原理图加的pad,他那边是没有问题的,我用的数字方法只有cdl网表,感觉是网表的问题
 楼主| 发表于 2022-3-2 13:35:30 | 显示全部楼层


Hu.Pengfei 发表于 2022-3-2 13:29
个人的思路:按照你的说法,感觉是因为版图的连线出了问题,请检查一下版图中的这根线(你在图中看到schema ...


版图应该是没有问题的,先前是在ICC中做的布局布线,ICC中的LVS检查没有问题,导入cadence中做lvs出现问题,怀疑是导出的cdl网表有问题,但是找不到问题原因
 楼主| 发表于 2022-3-2 16:25:21 | 显示全部楼层
已解决,厂家的问题,厂家给的原理图版图对不上,在LVS里把pad设置成黑盒子能通过就行。
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