电容阵列版图报错解决

April1999 · 发表于 2021-8-20 16:19:59

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当我把电容阵列从整体电路拷贝成一个单独的版图做DRC的时候就会出现如下报错，但是整体电路做DRC的时候就不会报错。

spartan313 · 发表于 2021-8-20 16:41:25

ptap 之类的drc 你看下具体

carter_jim · 发表于 2021-8-20 16:52:29

给的信息有点少，DR的意思是MOS管的S/D端距离最近的Pickup AA最大不超过35um，注意一下PW/NW

MrHlayout · 发表于 2021-8-20 17:03:40

latch Up的错

To70rO · 发表于 2021-8-20 17:11:31

看这描述应该是TAP没打好

April1999 · 发表于 2021-8-20 17:35:24

To70rO 发表于 2021-8-20 17:11
看这描述应该是TAP没打好

谢谢回复，好像确实是tap的问题，我打了PGR这个报错就解决了。

April1999 · 发表于 2021-8-20 17:37:46

现在出现一个新问题，我打了PGR，会出现报错：Space between NW and P+AA inside PW except LDBK is 0.12

April1999 · 发表于 2021-8-20 17:39:10

geo24 发表于 2021-8-20 16:41
ptap 之类的drc 你看下具体

嗯嗯，这个问题解决了，我想问一下我所用的是smic55两端的mom电容mom_2k_ckt，做在N阱里，这个N阱需要接什么吗

Inwhite · 发表于 2021-8-20 17:40:33

April1999 发表于 2021-8-20 17:37
现在出现一个新问题，我打了PGR，会出现报错：Space between NW and P+AA inside PW except LDBK is 0.12 ...

根据提示的把p-tap 到NW的距离拉开就行了

spartan313 · 发表于 2021-8-23 10:26:50

April1999 发表于 2021-8-20 17:39
嗯嗯，这个问题解决了，我想问一下我所用的是smic55两端的mom电容mom_2k_ckt，做在N阱里，这个N阱需要接 ...

上层NWELL 还是需要接一个电位

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