关于miller补偿直观理解方法的疑问

forestm

一直想对二级运放MILLER补偿有个直观的理解，觉得这样可以直观理解三级运放的嵌套MILLER补偿以及其他的MILLER等效问题，但这个问题总有些困扰。

书上的解释无非就是等效为一个主极点和一个输出极点，主极点没问题，但在谈非主极点时，将Cc短路，这样极点近似为gm/CL

我的问题是：既然已经等效为短路，那么在这个相对高的频率gm/CL附近扫频，电路此时只有一个极点gm/CL（因为Cc近似短路），那么何以导致40db/dec的下降呢?主极点的影响怎么

体现？

我不知道这是不是这种解释的漏洞？

期待大家的高见！

[ 本帖最后由 forestm 于 2007-12-18 09:54 编辑 ]

piao

期待答案中。。。

xdream

主极点下降20DB/dec,非主极点(如果是第二极点的话),当然下降40DB/dec

cczhanglc

说清楚点，两个极点的话，就是以这个斜率下降

arrowhead2007

dsfasdfasf

arrowhead2007

sdfasdfas

forestm

原帖由 xdream 于 2007-12-17 20:32 发表

                               
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主极点下降20DB/dec,非主极点(如果是第二极点的话),当然下降40DB/dec

我没有怀疑这点的下降速率，通过小信号推导，肯定是得到两个极点1/(ACc*ro1)和1/(Gm*CL),在非主极点附近是40db/dec.

通常在没有密勒器件的二阶电路中，在任何频率处都会存在两个极点，那么对于第二极点以后的下降速率。主极点贡献20db/dec，第二极点贡献20db/dec.

但是用RAZAVI这种直观的近似方法，认为高频时Cc短路，那很显然在较高频率处将电路仅仅等效成了一个只含有1/（Gm*CL）的单极点电路！

所以我觉得这种近似有点不太合理，你只会知道这里有1/（Gm*CL）这么一个极点，而你不能判定它是第二个极点还是第几个，因为此时你看不见其他的极点了

syracuse

高频时，输出mos被等效成一个diode连接的mos管，故此处产生一个pole，但是并不影响dominant pole的存在，这时两个pole都对frequency response产生影响，而不是你所说的，整个电路被等效成一个diode连接的mos。

forestm

原帖由 syracuse 于 2007-12-18 12:39 发表

                               
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高频时，输出mos被等效成一个diode连接的mos管，故此处产生一个pole，但是并不影响dominant pole的存在，这时两个pole都对frequency response产生影响，而不是你所说的，整个电路被等效成一个diode连接的mos。

那dominant pole是如何形成的呢？也是这个弥勒电容等效而成的吧，那同一个电容此时有了两种角色：1。短路 2。折算成A*Cc形成dominant pole。这是不是有点矛盾？