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查看: 1712|回复: 6

[求助] 请问systemverilog数组如何赋值

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发表于 2021-7-15 17:32:36 | 显示全部楼层 |阅读模式

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我有一个1bit的二维数组A[0:127]输入,testbench里我需要仿真赋值,但是别人给我的pattern是A=128'b0101010001001110......110100这种数,请问我应该如何赋值?
发表于 2021-7-15 21:34:47 | 显示全部楼层
for(i = 0; i < 128; i = i+1) begin
    a[i] = b[i];
end
发表于 2021-7-15 21:49:44 | 显示全部楼层
类型转换最快
 楼主| 发表于 2021-7-16 10:10:19 | 显示全部楼层


黑桃ACE 发表于 2021-7-15 21:34
for(i = 0; i < 128; i = i+1) begin
    a = b;
end


学会了,谢谢!
 楼主| 发表于 2021-7-16 10:11:18 | 显示全部楼层


A1985 发表于 2021-7-15 21:49
类型转换最快


请问可以具体一些吗,把128位的转换成数组形式吗
发表于 2021-7-16 11:32:04 | 显示全部楼层
typedef bit bit128t[0:127];

bit128t a = bit128t'(A);
 楼主| 发表于 2021-7-16 13:29:57 | 显示全部楼层


A1985 发表于 2021-7-16 11:32
typedef bit bit128t[0:127];

bit128t a = bit128t'(A);


学会了 谢谢!
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