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FPGA的时序预算

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发表于 2007-12-16 21:22:50 | 显示全部楼层 |阅读模式

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时序预算指的是逻辑设计之初,需要确定的逻辑内部处理能力(包括时钟频率 总线宽度 缓存大小等)
由于时序预算影响到整个逻辑系统的设计复杂性,甚至有时会影响到设计的可实现性。所以时序预算对
整个设计是非常重要的。
影响时序预算的几个关键指标包括但不限于以下几个因素:1、系统的吞吐能力。比如1Gbps的以太网报文
的最大处理能力大约为1.5MPPS,那么逻辑内部的处理能力就要求>1.5MPPS. 2、内部带宽是否出现膨胀。
有的设计内部带宽会远大于接口的带宽(如多播复制),这时候应该使内部每个处理环节的能力都不致于削
弱这种能力。3、内部设计流水。逻辑内部的流水对整个设计的影响很大。4、硬约束。主要是指FPGA硬件特
性。
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