标准单元浮空gate LVS报错

蛋zizi · 发表于 2021-6-19 17:17:03

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数字标准单元
在跑 LVS验证时浮空的gate（在实际电路没有用到做dummy用）会报错
如何解决？？

猴子砍树 · 发表于 2021-6-19 18:46:56

标准单元一般不会有这种问题，如果你在顶层跑出来的，建议你单独跑一下标准单元

andyfan · 发表于 2021-6-19 19:01:38

用tie high / tie low接死

蛋zizi · 发表于 2021-6-21 08:46:25

猴子砍树发表于 2021-6-19 18:46
标准单元一般不会有这种问题，如果你在顶层跑出来的，建议你单独跑一下标准单元 ...

单独跑标准单元是没有报错的

蛋zizi · 发表于 2021-6-21 09:21:54

对不住各位兄弟们了仔细看了看还是版图出了问题尴尬了（用错标准单元）

光非 · 发表于 2021-6-21 20:27:17

我来水一下，哈哈哈

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