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[求助] 版图LVS

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发表于 2021-6-7 10:06:48 | 显示全部楼层 |阅读模式

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版图过LVS时,有笑脸,但是Extraction Results不对,请问是什么问题呀,是带IO的读出电路,有三组电地,GNDA,VDD33A;GNDR,VDDR;APVD_GND,APVD_VDD image.png



发表于 2021-6-7 10:09:57 | 显示全部楼层
提示软连接,可以按提示 打开 S 记录选项看看是哪。
个人觉得应该是某些层发生交叠 影响器件的识别
发表于 2021-6-7 10:11:45 | 显示全部楼层
根据他这个描述,你这个他认为可能是二极管的器件有三个端子,你可以去看看他报的这个坐标有什么问题
发表于 2021-6-7 10:47:51 | 显示全部楼层
同一个地方接不通的pin了
发表于 2021-6-7 14:01:04 | 显示全部楼层
器件 叠层 导致器件识别有问题已经有提示了,
在错误的器件识别前提下工具认为软连接。
检查覆盖的层吧,比如 区分 sub  的层,或者整个rule 对sub 的定义是否跟器件定义有冲突。
在这就是这个器件是否有一个用于区别其他器件的层,他有没有覆盖好。
发表于 2021-6-7 15:40:16 | 显示全部楼层
LVS options上添加POWER/GND或许可以帮到你
 楼主| 发表于 2021-6-9 08:22:50 | 显示全部楼层
好的 谢谢大家
 楼主| 发表于 2021-6-9 08:24:48 | 显示全部楼层
因为有三组电地,所以用subcut区分开,是subcut把另一组电地的电路也选中了,改了subcut就可以了。谢谢大家
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