VHDL语法求助

misrig001 · 发表于 2021-4-27 22:03:37

因为没有怎么用过Vhdl，对VHDL中的一段代码非常困惑：
      for k in 0 to 63 generate
         buf_a(k) <= buf_b((k-62) mod 64)
   end generate
这个循环里面，k-62大部分是负数，这两个数组该怎么对应呢，请熟悉VHDL的大虾帮忙解答一下

失重wlq · 发表于 2021-4-28 10:40:58

溢出循环？负数从全f往下减？

misrig001 · 发表于 2021-4-28 22:11:13

失重wlq 发表于 2021-4-28 10:40
溢出循环？负数从全f往下减？

不清楚啊，不知道vhdl里面是什么行为，有没有懂的给科普一下

anpengfei · 发表于 2021-4-29 11:19:59

主要是mod运算
k=0~63,
k-62=-62,-61...-2,-1,0,1 ,
k-62 mod 64 => -62,-61...-2,-1,0,1 mod 64 = 2,3,4...62,63,0,1
设计牛逼啊

[求助] VHDL语法求助

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