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黑桃ACE 发表于 2021-3-19 22:12 如果是XILINX器件的话,寄存器R组的时钟用BUFGMUX输出,A控制时,输出clk_high,B控制时输出clk_low,同时A ...
fate_szs 发表于 2021-3-20 04:48 您好!感谢您的回复!! 我使用了BUFGMUX,并且时钟设置了分组约束(set_clock_groups),没有出现c ...
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