Divider用pss+pnoise仿真相噪出现pss不收敛。该如何解决？

Sakura314

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kangnaixin

确认你的电路内部节点最低频率是多少，设置成beat fre，该频率未必是输出频率

its_aleix

我发现是MMD内部存在一个2、3分频一直在变化，比如我160MHz的VCO输出，分频器内部依次出现80、40，然后在下一级的时候出现一个2、3分频变化，导致频率从20变化到13.333，一直在变，这个频率变化导致pss不收敛，我调小beat freq之后，ponies出来的图形也不对，我现在也不晓得咋整，没找到解决防范。不知道楼主解决了没有？

kimerPrince

its_aleix 发表于 2025-2-10 00:31
我发现是MMD内部存在一个2、3分频一直在变化，比如我160MHz的VCO输出，分频器内部依次出现80、40，然后在下 ...

应该是23分频内部有节点悬空产生分频比错误，VCO的输出频率太小导致动态逻辑错误

its_aleix

kimerPrince 发表于 2025-4-9 12:21
应该是23分频内部有节点悬空产生分频比错误，VCO的输出频率太小导致动态逻辑错误
...

前辈您好，我查看了一下电路，对于您说的第一项，23分频内部是没有节点悬空的

第二项的话，VCO输出160MHz频率，您的意思是说这个频率太低了，导致动态逻辑错误吗，这个我不太理解。
下面是我的理解
我电路是为了实现160MHz分频道8MHz，也就是分频比是20，按照23分频的计算的话，20不是2和3的幂次方，所以我理解他一定会有一个点的频率是在变化，为了实现1.5倍，但按照计算的话也不是完整的8MHz，这个地方我仍然有疑惑。
最后，感谢您的回回答，我会再仔细考虑您说的话。