求助！如何用verilog设计一个深度为4的buffer？

JINNINE · 发表于 2020-11-24 11:59:29

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请各位大哥指点！小弟需要一个深度为4的buffer，将数据暂存在里面（数据最多16个所以深度为4的buffer就够用了）。buffer的输出要做判断，buffer里存的每个数据自己都带着代表输出顺序的4位标志位（如4'b0000代表应该第一个输出，4'b0001代表应该第二个输出，以此类推），需要先找第一个（0000），输出；然后再查找第二个（0001），输出......

请问各位高手，如何实现这样的功能？具体的verilog代码可以参考一下吗？小弟先行谢过！！

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