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[求助] Verilog中,如何检测 仿真值 和 期望值 ?

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发表于 2020-11-17 18:19:57 | 显示全部楼层 |阅读模式

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Verilog中,如何检测 仿真值 和 期望值 ?

主要是这个判断语句怎么写?

谢谢大家了
发表于 2020-11-17 22:29:36 来自手机 | 显示全部楼层
assert(expected_value==my_value);
发表于 2020-11-19 19:24:17 | 显示全部楼层
题主是刚接触数字IC就干验证了?建议从设计做起吧
 楼主| 发表于 2020-11-20 15:58:42 | 显示全部楼层


dullman 发表于 2020-11-17 22:29
assert(expected_value==my_value);


谢谢了

还有一个疑问,如何实现在某个时间点去判断呢?

比如说100ns,或者200ns的时候去判断?

assert貌似是system verilog的语法,我对这个不熟悉

再次感谢了!
发表于 2020-11-21 01:31:05 来自手机 | 显示全部楼层


wupingee 发表于 2020-11-20 15:58
谢谢了

还有一个疑问,如何实现在某个时间点去判断呢?


initial begin
    #100ns;
    assert(my_value==expected_value);
end
发表于 2020-11-21 01:32:01 来自手机 | 显示全部楼层
搞仿真验证,还是学学sv吧。
发表于 2020-11-21 16:33:41 | 显示全部楼层


Captain_Rail 发表于 2020-11-19 19:24
题主是刚接触数字IC就干验证了?建议从设计做起吧


您这个说反了吧,验证的要求肯定没有设计高
发表于 2020-11-21 16:45:15 | 显示全部楼层


wupingee 发表于 2020-11-20 15:58
谢谢了

还有一个疑问,如何实现在某个时间点去判断呢?


assert (trigger |-> express)
发表于 2020-11-22 09:21:58 来自手机 | 显示全部楼层


dullman 发表于 2020-11-21 01:31
initial begin
    #100ns;
    assert(my_value==expected_value);


verilog里用wait语句就行了。
initial
begin
#100ns
wait(my_value==expected_value)
$display() or $stop
end
 楼主| 发表于 2020-11-23 13:39:13 | 显示全部楼层


dullman 发表于 2020-11-21 01:31
initial begin
    #100ns;
    assert(my_value==expected_value);


谢谢了,我按照这个思路去debug
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